一種用FPGA實(shí)現(xiàn)BCH(31,21)編/解碼的方法

全部作者： 徐宏緯 第1作者單位： 北京郵電大學(xué)電信工程學(xué)院 論文摘要： 本文簡要介紹了2元BCH碼的1般原理并分析了2元BCH碼的編碼和解碼的理論基礎(chǔ)和串/并行編碼方法及代數(shù)譯碼、非代數(shù)譯碼的概念，分析了2元BCH碼的檢錯和糾錯能力，主要給出了1種用FPGA實(shí)現(xiàn)2元BCH(31,21)碼的并行編碼與伴隨式譯碼的解決方案，還給出了用這種方法實(shí)現(xiàn)的編解碼器的部分仿真結(jié)果。 關(guān)鍵詞： EDA；FPGA；BCH碼；伴隨式；1致校驗(yàn)矩陣 (瀏覽全文) 發(fā)表日期： 2007年03月22日 同行評議：

（暫時沒有）

綜合評價(jià)： （暫時沒有） 修改稿：

【一種用FPGA實(shí)現(xiàn)BCH(31,21)編/解碼的方法】相關(guān)文章：

用匯編語言實(shí)現(xiàn)BCH解碼校驗(yàn)算法08-07

ADPCM語音編解碼電路設(shè)計(jì)及FPGA實(shí)現(xiàn)07-12

利用Verilog HDL實(shí)現(xiàn)基于FPGA的分頻方法09-02

用FPGA實(shí)現(xiàn)異步串口與同步串口的轉(zhuǎn)換08-27

WCDMA主同步的FPGA實(shí)現(xiàn)06-15

用單片機(jī)實(shí)現(xiàn)SRAM工藝FPGA的加密應(yīng)用09-03

用XC9572實(shí)現(xiàn)HDB3編解碼設(shè)計(jì)09-13

自適應(yīng)算術(shù)編碼的FPGA實(shí)現(xiàn)07-07

基于FPGA的HDLC通信模塊的實(shí)現(xiàn)05-14

一種Flyback軟開關(guān)實(shí)現(xiàn)方法10-25